Cypress cy37256p160 Jedec Fuse File: CounterTop.jed This file was created on 04/02/2003 at 19:05:47 by C37KFIT.EXE 22/DEC/2000 [v4.02 ] 6.2 IR 27 cy37256p160* QP160* Number of Pins* QF136704* Number of Fuses* F1* Note: Default fuse setting 1* G0* Note: Security bit Unprogrammed* NOTE DEVICE cy37256p160* NOTE PACKAGE cy37256p160-125ac* NOTE PROPERTY BUS_HOLD ENABLE* NOTE PINS dco(0):2 dco(1):3 dco(2):4 sysclk:19 count_signal(1):23 count_signal(2):24 * NOTE PINS outen:42 count_signal(3):97 count_signal(4):98 dci(2):117 dci(1):118 * NOTE PINS dci(0):119 d(15):122 d(14):123 d(13):124 d(12):125 d(11):126 * NOTE PINS d(10):127 d(9):128 d(8):129 d(7):131 d(6):132 d(5):133 d(4):134 * NOTE PINS d(3):135 d(2):136 d(1):137 d(0):138 c(6):153 c(5):154 c(4):155 * NOTE PINS c(3):156 c(2):157 c(1):158 c(0):159 * NOTE NODES sync_out3:924 tempcount_9B:934 tempcount_0B:940 lowcountd_9:950 * NOTE NODES lowcountd_3:952 lowcountd_11:954 lowcountc_0:956 lowcountd_0:958 * NOTE NODES lowcountd_12:960 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LAB 1 OE Muxes C5,C6,C26* L007126 00000000000* Note: LAB 1 Bank Polarity Config bits[13..18,28..31,27]* L007137 111111111111111111111111111111111110 111111111111111111111111111111111110 111111111111111111111111111111111110 011111111111111111111111111111111111 101111111111111111111111111111111111 111111111111111111111111111111111110 111111111111111111111111111111111110 111111111111111111111111111111111110 111111111111111111111111111111111110 111111111111111111111111111111101111 111111111111111111111111111111111110 111111111111111111111111111111111110 111111111111111111111111101111111111 111111111111111111111111111111111110 111111111111111111111111111111111110 111111111111111111111111111111111110 111111111111111111111111111111111110 111111111111111111111111111111111110 111111111111111111111111111111111110 111111111111111111111111111111111110 111111111111111111111111111111111110 111111111111111111111111111111111110 111111111111111111111111111111111110 111111111111111111111111111111111110 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Note: PIM Interconnect LAB 2* L017083 0* Note: High/Low Power* L017084 111111101111111111101111111111111111111111111111111111111111111111111111111111 111111101111111111111111101111111111111111111111111111111111111111111111111111 111111111111111111111111111111111111111111111111111111111111111111111111111111 111111111111111111111111111111111111111111111111111111111111111111111111111111 111111111111111111111111111111111111111111111111111111111111111111111111111111 111111111111111111111111111111111111111111111111111111111111111111111111111111 111111111111111111111111111111111111111111111111111111111111111111111111111111 111111111111111111111111111111111111111111111111111111111111111111111111111111 111111111111111111111111111111111111111111111111111111111111111111111111111111 111111111111111111111111111111111111111111111111111111111111111111111111111111 111111011111111111101111101111111111111111111111111111111111111111111111111111 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LAB 4 PTM Steering Array* L032604 0001111 1111001 1111001 1111001 1111001 1111001 0001111 0001011 1111001 1111001 1111001 1111001 1111001 1111001 1111001 0001011 * Note: LAB 4 Macrocells Config Bits C0,C1,C2,C3,C4-C7,C24,C25* L032716 000000000000000000000000000000000000* Note: LAB 4 OE Muxes C5,C6,C26* L032752 00000000000* Note: LAB 4 Bank Polarity Config bits[13..18,28..31,27]* L032763 111111111111111111111111101111111111 111101111111111111111111111111111111 111111111101111111111111111111111111 111111111111111011111111111111111111 111111111111111111111111111101111111 111111111111101111111111111111111111 111101111111111111111111111111111111 111111111111111111011111111111111111 111111111111111111011111111111111111 111111111111111111101111111111111111 111111111111111111110111111111111111 111111111111111101111111111111111111 111111111111110111111111111111111111 111101111111111111111111111111111111 111011111111111111111111111111111111 111111111111111111111111011111111111 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111111111111111111111111111111111111111111111111111111111111111111111111111111 111111111111111111111111111111111111111111111111111111111111111111111111111111 010111011111101101011111110111010111111111110111111111111101111111111111111111 111111111111111111111111111111111111111111111111111111111111111111111111111111 111111111111111111111111111111111111111111111111111111111111111111111111111111 111111111111111111111111111111111111111111111111111111111111111111111111111111 011111011111101101011111111111111111111111110111111111111101111111111111111111 111111111111111111111111111111111111111111111111111111111111111111111111111111 111111111111111111111111111111111111111111111111111111111111111111111111111111 111111111111111111111111111111111111111111111111111111111111111111111111111111 011111111111101111011111111111111111111111110111111111111101111111111111111111 111111111111111111111111111111111111111111111111111111111111111111111111111111 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111111111111111111111111111111111111111111111111111111111111111111111111111111 111111111111111111111111111111111111111111111111111111111111111111111111111111 111111111111111111111111111111111111111111111111111111111111111111111111111111 111111111111111111111111111111111111111111111111111111111111111111111111111111 111111111111111111111111010111101111111111111111111111111111111111111111111111 000000000000000000000000000000000000000000000000000000000000000000000000000000 111111111111111111111111111111111111111111111111111111111111111111111111111111 * Note: LAB 8 BANK CLK* L066580 010000000000 100000000000 100000000000 100000000000 100000000000 100000000000 100000000000 100000000000 100000000000 100000000000 100000000000 100000000000 100000000000 100000000000 100000000000 010000000000 * Note: LAB 8 PTM Steering Array* L066772 0010100 0010000 0010100 0010000 0010100 0010000 0010100 0010000 0010100 0010000 0010100 0010000 0010100 0010000 0010100 0010000 * Note: LAB 8 Macrocells Config Bits C0,C1,C2,C3,C4-C7,C24,C25* L066884 000000000000000000000000000000000000* Note: LAB 8 OE Muxes C5,C6,C26* L066920 00000000000* Note: LAB 8 Bank Polarity Config bits[13..18,28..31,27]* L066931 111101111111111111111111111111111111 111011111111111111111111111111111111 111111111111111110111111111111111111 111111111111101111111111111111111111 111011111111111111111111111111111111 111111111111111110111111111111111111 111111111111111101111111111111111111 111011111111111111111111111111111111 111111111111111101111111111111111111 111111111111111110111111111111111111 111011111111111111111111111111111111 111111111111111101111111111111111111 110111111111111111111111111111111111 111111111111111111110111111111111111 111111111111111101111111111111111111 111101111111111111111111111111111111 011111111111111111111111111111111111 111111111111111111111111111111111110 111111111111111111111111111111111110 111111111111111101111111111111111111 111111111111111110111111111111111111 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9 BANK CLK* L075122 111111000000 000010000000 100000000000 100000000000 100000000000 100000000000 100000000000 100000000000 100000000000 100000000000 100000000000 100000000000 100000000000 100000000000 100000000000 111111000000 * Note: LAB 9 PTM Steering Array* L075314 0001111 0010000 0010100 0010000 0010100 0010000 0010100 0010000 0010100 0010000 0010100 0010000 0010100 0010000 0010100 0001011 * Note: LAB 9 Macrocells Config Bits C0,C1,C2,C3,C4-C7,C24,C25* L075426 000000000000000000000000000000000000* Note: LAB 9 OE Muxes C5,C6,C26* L075462 00000000000* Note: LAB 9 Bank Polarity Config bits[13..18,28..31,27]* L075473 111111111111111111111111111111011111 111101111111111111111111111111111111 111111111111111111011111111111111111 111111111111111111101111111111111111 111111111111111111011111111111111111 111111111111111111011111111111111111 111101111111111111111111111111111111 111111111111110111111111111111111111 111111111111111111011111111111111111 111111111111111011111111111111111111 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111111111111111111111111111111111111111111111111111111111111111111111111111111 111111111111111111111111111111111111111111111111111111111111111111111111111111 010101110111100111011101111111111111110101111111111101111111111111111111111111 111111111111111111111111111111111111111111111111111111111111111111111111111111 111111111111111111111111111111111111111111111111111111111111111111111111111111 111111111111111111111111111111111111111111111111111111111111111111111111111111 110111110111100111011101111111111111110101111111111111111111111111111111111111 111111111111111111111111111111111111111111111111111111111111111111111111111111 111111111111111111111111111111111111111111111111111111111111111111111111111111 111111111111111111111111111111111111111111111111111111111111111111111111111111 110111110111100111111101111111111111111101111111111111111111111111111111111111 111111111111111111111111111111111111111111111111111111111111111111111111111111 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1111001 1111001 1111001 1111001 1111001 1111001 1111001 1111001 1111001 1111001 1111001 * Note: LAB 13 Macrocells Config Bits C0,C1,C2,C3,C4-C7,C24,C25* L109594 000000000000000000000000000000000000* Note: LAB 13 OE Muxes C5,C6,C26* L109630 00000000000* Note: LAB 13 Bank Polarity Config bits[13..18,28..31,27]* L109641 111111111111111111111111111111111110 111111111111111111111111111111111110 111111111111111111111111110111111111 111111111111101111111111111111111111 111111111011111111111111111111111111 111111111111111111111111111111111110 111111111111111111111111111111111110 111111111111111111111111111111111110 111111111111111111111111111111111110 111111111111111111111111111111111110 111111111111111111111111111111111110 111111111111111111111111111111111110 111111111111111111111111111111111110 111111111111111111111111111111111110 111111111111111111111111111111111110 111111111111111111111111111111111110 111111111111111111111111111111111110 111111111111111111111111111111111110 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111111111111111111111111111111111111111111110111111111111111111111111111111111 111111111111111111111111111111111111111111110111111111111111111111111111111111 111111111111111111111111111111111111111111110111111111111111111111111111111111 111111111111111111111111111111111111111111110111111111111111111111111111111111 111111110111111111111111111111111111111111111111111111111111111111111111111111 101111111111111111111111111111111111111111111111111111111111111111111111111111 111111111111111111111111111111111111111111111111111111111111111111111111111111 * Note: LAB 15 BANK CLK* L126374 010000000000 000000000000 100000000000 000000000000 100000000000 000000000000 100000000000 000000000000 100000000000 100000000000 100000000000 000000000000 100000000000 000000000000 100000000000 000000000000 * Note: LAB 15 PTM Steering Array* L126566 1111101 1111001 0000101 1111001 0000101 1111001 0000101 1111001 0000101 0000000 0000101 1111001 0000101 1111001 0000101 1111001 * Note: LAB 15 Macrocells Config Bits C0,C1,C2,C3,C4-C7,C24,C25* L126678 110000110000110110110110110000110000* Note: LAB 15 OE Muxes C5,C6,C26* L126714 00001111000* Note: LAB 15 Bank Polarity Config bits[13..18,28..31,27]* L126725 111111111011111111111111111111111111 111111111110111111111111111111111111 111111111111111111111111111111111110 111111111111111111111111111111111110 110111111111111111111111111111111111 111111111111111111111111111111111110 110111111111111111111111111111111111 111111111111111111111111111111111110 111111111111111111111111111111111110 111111111111111111111111111111101111 111111111111111111111111111111111110 111111101111111111111111111111111111 111111111110111111111111111111111111 111111111111111111111111111111111110 111111111111101111111111111111111111 111111111111011111111111111111111111 111111111111111111111111111111111110 111111111111111111111111111111111110 111111011111111111111111111111111111 111111111111111111111111111111111110 111111111111111111111111111111111110 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LAB 16 BANK CLK* L134916 010000000000 000000000000 100000000000 000000000000 100000000000 000000000000 100000000000 000000000000 100000000000 000000000000 100000000000 000000000000 100000000000 000000000000 100000000000 000000000000 * Note: LAB 16 PTM Steering Array* L135108 0000101 1111001 0000101 1111001 0000101 1111001 0000101 1111001 0000101 1111001 0000101 1111001 0000101 1111001 0000101 1111001 * Note: LAB 16 Macrocells Config Bits C0,C1,C2,C3,C4-C7,C24,C25* L135220 110000110000110110110110110000110000* Note: LAB 16 OE Muxes C5,C6,C26* L135256 00001111000* Note: LAB 16 Bank Polarity Config bits[13..18,28..31,27]* L135267 111111111111111111111111111111111110 111110111111111111111111111111111111 111111111111111111111111111111111110 111111111111111111111111111111111110 111111111111111111111111111111111110 111111111111111011111111111111111111 111111111111111111111111111111111110 111111111111111111101111111111111111 111111111111111111111111111111111110 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111111111111111111111111111111111110 111111111111111111111111111111111110 111111111111111111111111111111111110 * Note: PIM Interconnect LAB 16* L136671 0* Note: High/Low Power* L136672 11000* Note: 19 * L136677 11000* Note: 22 * L136682 11000* Note: 99 * L136687 11000* Note: 102 * L136692 1100* Note: 59 * L136696 1* Note: BUS_HOLD_ENABLE/DISABLE* L136697 0000000*Note: STATIC FUSES * CF7A8* Note: Fuse Checksum* U0000000000000000 * Note: User Device ID * 63BD